浮点数加减法模块设计思路
发布时间：2008-11-25阅读：933
入口条件：被加数或被减数的尾数存放在ACCBHI、ACCBLO单元中，被加数或被减数的阶码存放在EXPB中。
加数或减数的尾数存放在ACCAHI、ACCALO单元中，加数或减数的阶码存放在EXPA中．
出口条件：和或差放在ACCBHI、ACCBLO单元中；
余数存放在ACCCHI、ACCCLO单元中．
下一篇：RS-485接口简介
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入口条件：被加数或被减数的尾数存放在ACCBHI、ACCBLO单元中，被加数或被减数的阶码存放在EXPB中。
加数或减数的尾数存放在ACCAHI、ACCALO单元中，加数或减数的阶码存放在EXPA中．
出口条件：和或差放在ACCBHI、ACCBLO单元中；
余数存放在ACCCHI、ACCCLO单元中．
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